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Ingeniero/a de Diseño HDL (FPGA) Senior.

Experiencia mínima: Al menos 3 años en entornos DevOps o como ingeniero de infraestructura de software.

Ingeniero/a de Diseño HDL (FPGA) Junior.

Experiencia mínima: Al menos 3 años en entornos DevOps o como ingeniero de infraestructura de software.

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