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Pour une de nos familles, nous sommes à la recherche d'un(e) baby-sitter à domicile à BIOT pour 6 heures de travail par semaine pour baby-sitter 1 enfant, 8 ans.Tâches confiées : garde d'enfants/baby-sitting, préparation des repas, aide à la toilette, sortie d'école, activités petite enfanc

Kinougarde est n°1 de la garde d’enfants à domicile. Tâches confiées : garde d'enfants/baby-sitting, préparation des repas, aide à la toilette, sortie d'école, activités petite enfance. Vous avez 18 ans minimum et avez l’habitude de faire de la garde d'enfants ou du baby-sitting ?.

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Pour une de nos familles, nous sommes à la recherche d'un(e) garde d’enfants à domicile à CANNES pour 13 heures de travail par semaine pour garder 2 enfants, 2 ans.Tâches confiées : garde d'enfants/baby-sitting, préparation des repas, aide à la toilette, sortie d'école, jeux, toilette, act

Robertet, leader mondial des ingrédients naturels pour l'industrie des arômes, de la parfumerie et des actifs beauté, recherche aujourd'hui un(e) Chauffeur PL inter-sites (H/F) pour renforcer ses équipes Logistique. Sous la responsabilité directe du chef de quai, vous avez la charge de transférer les marchandises entre les différents sites du groupe ainsi que chez les partenaires externes dans le strict respect des consignes, instructions et réglementations applicables. • Vérifie la concordance des documents d’expédition et des marchandises à charger, • Vérifie avant chargement la conformité de l’étiquetage de chaque emballage ainsi que sa parfaite intégrité, ainsi que la conformité des documents matières dangereuses et régie., • Charge son véhicule avec les outils de manutention à sa disposition., • Circule dans le strict respect des règles de sécurité et de la réglementation Matières Dangereuses., • Décharge les marchandises dans la zone indiquée par le chef de quai et transmet les documents d’accompagnement à la réception., • Informe immédiatement le chef de quai de toute anomalie ou avarie sur les marchandises ou sur le véhicule., • Fait émarger, dater puis tamponner le BL chez le client ; remet le BL émargé au Sce Expéditions., • S’assure de la propreté de son véhicule et des outils à sa disposition, et vérifie régulièrement l’état général de son véhicule pour éviter toute défaillance., • Localise les différents ateliers et services des sites Robertet, les dépôts extérieurs et les différents points de collecte de nos partenaires locaux (Saccof, Gerbino…), • Chargement/déchargement navette inter-sites, • Remplace occasionnellement le chauffeur VL, • Remplace occasionnellement le chauffeur navette courrier et personnel Le profil recherché • Permis Poids Lourd indispensable + licence TMD, • Bonne connaissance de la réglementation routière et transport Matières Dangereuses., • Utilisation du chariot élévateur CACES 3 + 5. Vos atouts personnels • Rigueur et sens du détail., • Réactivité et autonomie., • Esprit d'équipe et goût du travail bien fait. Ce que Robertet vous offre En rejoignant Robertet, vous bénéficiez de (selon les règles en vigueur dans l'entreprise) : • Une rémunération attractive : salaire fixe selon profil et expérience + prime équipe + prime panier pour chaque jour travaillé, • Un treizième mois versé en novembre, • Une prime d'assiduité de 60e versée si vous n'avez pas d'absence sur le mois, • Une prime de vacances de 350e versée au mois de juin sous condition d'ancienneté, • Un package prime « famille », • Acquisition de RTT, • Participation, • Aide au transport., • Mutuelle & Prévoyance., • Comité d'Entreprise actif. Organisation du travail • Horaires en journée : 08H00-16H30 ou 07h30-16h00, selon le planning de l’atelier, • Environnement industriel, ateliers multi-activités, respect des normes, • Distance entre chaque site Robertet de 5 à 7km, • Mise à disposition d'un équipement de protection complet (EPI, tenue de travail)

-- Résumé de l'annonce en 5 points 🎯-- • Profil recherché avec 12 années d’expérience min - Salaire de 50 à 55K €, • Instant System est un éditeur qui développe des applis web et mobile de mobilité urbaine., • 12 ans d'existence et 125 personnes dans nos locaux de Sophia-Antipolis., • Application utile à la société et qui œuvre pour l'environnement !, • Stack : Java 11 -> 21, Springboot 2.3 -> 3.2, JPA, Hibernate, Microservices, MapStruct, Lombok, OpenAPI, MySQL, Redis, Sonar, Git, Bitbucket, Maven, IntelliJ, Rabbit MQ, Kafka, architecture multi-tenant, ... -- Que faisons-nous et qui sommes-nous ? -- La mobilité et les transports sont la 1ère source de pollution dans le monde. Instant System développe des applications pour faire changer les habitudes, être plus vertueux 🌱 et mieux vivre ensemble. Concrètement, nos applications web et mobiles guident les voyageurs en ville. Bus, train, trottinette, vélo électrique, co-voiturage et bien d’autres : nous mixons toutes les possibilités dans une solution unifiée pour nos usagers. Créé il y a 12 ans, nous embarquons aujourd’hui 125 personnes. Notre siège social et notre centre R&D se trouvent à Sophia-Antipolis. Tu rejoins donc un vrai éditeur de logiciels, pas la petite startup créée il y 6 mois 😉 Nous fonctionnons aujourd’hui en marque blanche avec les collectivités publiques comme les villes, les Métropoles et les Régions. Avec plus de 15 millions d’utilisateurs réguliers, tu as sûrement déjà vu ou utilisé nos solutions : Ile-de-France Mobilités à Paris, TCL à Lyon ou Envibus avec la Communauté d’Agglomération de Sophia-Antipolis. Nos objectifs pour l'avenir sont ambitieux et réalisables 🚀 : continuer le développement à l’international et en France. Sans oublier le lancement de notre offre SaaS 100% paramétrable et notre nouvelle solution dédiée aux entreprises et à la mobilité de leurs employés. -- Comment est l’ambiance chez nous ? -- L’ambiance est studieuse et on apprécie également se retrouver ensemble : barbecue sur la terrasse, petit déjeuner royal, raclettes party, team building (été ET hiver) et soirée à thème ou musical. Pour les sportifs, une coach est présent 2 fois par semaine pour des séances de crossfit. Tu pourras également profiter d’une salle de musique 🎸, de 2 terrasses et d’une cafet’ avec babyfoot, boissons caféinées/chocolatées et fruits en libre accès (livraison 3 fois par semaine). Nous sommes installés dans de nouveaux locaux, spacieux et lumineux, bien desservis par les transports. Attention, nous ne sommes pas une grosse structure avec des process et règles strictes. Tout n’est pas parfait et tu rejoins une société vivante qui continue de s’améliorer, de s’organiser et où tu pourras apporter ta pierre à l'édifice ! Peut-être en as-tu déjà discuté avec des amis, nous sommes reconnus sur Sophia-Antipolis pour avoir des équipes et des technos à la page 💻 (cf. stack technique plus bas). Tu le verras, nos produits sont très complexes techniquement et fonctionnellement. Bref, tu ne vas pas t’ennuyer ! -- Que vas-tu faire et dans quel contexte ? -- Tu rejoindras notre département technique de 80+ personnes. Nos projets sont gérés selon un mode Agile que nous avons adapté à notre fonctionnement sur des cycles de 2 semaines. Et cela fait maintenant quelques mois que l’on s’est lancé avec SAFe. Tu le verras par toi-même, les PI Planning sont particulièrement animés ! Nous fonctionnons en petites équipes travaillant, soit sur des projets polyvalents pour un client, soit sur une ligne de produit spécifique : transport, vente, SaaS, R&D, … Ce sont des squads d’une 10aine de personnes composées de développeurs mobile natif, web, back-end, tech lead/architecte, QA,, Business Analyst, DevOps, Delivery Manager. Tu auras la chance de travailler de beaux projets avec du SaaS et du cloud ! Ton quotidien sera varié : • Échanges avec toutes les parties prenantes des projets : DevOps, QA, BA, …, • Réalisation des études et analyses techniques : bases de données, modules, …, • Développement du back-end de nos plateformes., • Mise en place de tests et insertion dans nos pipelines CI/CD., • Réalisations de documentations techniques., • Aide à la montée en compétences de développeurs plus juniors, • Veille technologique et amélioration continue de l’existant. Exemples de projets que tu pourrais rejoindre à ton arrivée : • Equipe Vente : tu contribueras à développer la boutique MaaS de notre produit. C’est une nouvelle fonctionnalité qui a été lancée il y a quelques mois. Elle permet à un usager de consommer des billets combinant plusieurs modes de transport différents., • Equipe IDFM pour le pass Navigo à Paris utilisé par des millions de franciliens au quotidien : tu participeras à l’amélioration et la maintenance des interconnexions de web services et le traitement/transmission des nombreuses données (avec les API de la SNCF par exemple). Stack technique : Java 11 -> 21, Springboot 2.3 -> 3.2, JPA, Hibernate, Microservices, MapStruct, Lombok, OpenAPI, MySQL, Redis, Sonar, Git, Bitbucket, Maven, IntelliJ, Rabbit MQ, Kafka, architecture multi-tenant, ... C’est un poste polyvalent où tu pourras être force de proposition. -- Quelles sont les conditions salariales / avantages ? -- • Fourchette de salaire de 50-55K €, • Contrat CDI Cadre, • RTT, • 2 jours de télétravail/semaine possible (à l'issu de la période d'essai), • Crèche d'entreprise -- As-tu le profil que nous recherchons ? -- Un Bac+5 en informatique est conseillé mais ce n’est pas une obligation. Nous accordons plus d’importance à tes compétences et ta personnalité que tes formations. Le profil idéal que nous cherchons a au minimum 10 ans d’expérience en développement Java Back-End. C’est un poste où tu seras immédiatement opérationnel ! Compétences obligatoires : • Bonne maîtrise du langage Java et des frameworks associés (Springboot, Hibernate, …), • Maîtrise des bases de données (idéalement MySQL et MongoDB) : modélisation, optimisation, … (mais sans être DBA), • Maîtrise des architectures distribuées et microservices, • Maîtrise des pratiques d’intégration continue, avoir une culture DevOps et Cloud, • Maîtrise des tests unitaires et intégration, • Maîtrise des méthodologies agiles Compétences optionnelles : • Connaissances sur un des Cloud du marché (GCP, AWS ou Azure), • Connaissances sur Docker, Kubernetes, Jenkins, • Connaissances sur Kafka Qualités attendues : leadership, autonomie, esprit d’équipe, force de proposition, communication, curiosité et humilité, ... -- Quel est le process de recrutement ? -- Tu auras un 1er échange téléphonique, puis 2 entretiens dans nos locaux ou en visio, avec un test technique à réaliser chez toi. Si ton CV n’est pas complet, ce n’est pas grave car on privilégie l’échange direct avec toi. Ce que l’on attend de toi ce sont avant tout tes talents, ta passion et ton état d’esprit ! Instant System s'engage en faveur d'un recrutement inclusif, de la diversité et de l'égalité des chances. Tous nos postes sont ouverts, à compétences égales, aux personnes en situation de handicap. Ne passe pas à côté et postule !

Pour une de nos familles, nous sommes à la recherche d'un(e) nounou à domicile à GRASSE pour 10 heures de travail par semaine pour garder 2 enfants, 8 ans, 10 ans.Tâches confiées : garde d'enfants/baby-sitting, préparation des repas, aide à la toilette, sortie d'école, activit

Pour une de nos familles, nous sommes à la recherche d'un(e) garde d’enfants à domicile à CANNES pour 13 heures de travail par semaine pour garder 2 enfants, 2 ans.Tâches confiées : garde d'enfants/baby-sitting, préparation des repas, aide à la toilette, sortie d'école, jeux

Pour une de nos familles, nous sommes à la recherche d'un(e) garde d’enfants à domicile à CANNES pour 13 heures de travail par semaine pour garder 2 enfants, 2 ans.Tâches confiées : garde d'enfants/baby-sitting, préparation des repas, aide à la toilette, sortie d'école, jeux

Pour une de nos familles, nous sommes à la recherche d'un(e) baby-sitter à domicile à PEGOMAS pour 5 heures de travail par semaine pour baby-sitter 1 enfant, 4 ans.Tâches confiées : garde d'enfants/baby-sitting, préparation des repas, aide à la toilette, sortie d'école, activi

DescriptionSenior Staff Design Verification Engineer F/H Localisation : Sophia Antipolis, France Arteris connecte l’innovationNotre technologie aide les entreprises les plus visionnaires au monde — des startups aux leaders du Fortune 500 — à concevoir des semi-conducteurs plus intelligents et plus performants, notamment des SoC et des chiplets. De la voiture que vous conduisez à l’IA dans le cloud, Arteris connecte les technologies innovantes qui façonnent le monde de demain.Votre rôle en tant que Senior Staff Design Verification Engineer chez ArterisVous souhaitez contribuer aux technologies qui constituent le cœur de certains des SoC les plus avancés au monde ?En tant que Senior Staff Design Verification Engineer, vous rejoindrez une équipe d’experts afin de contribuer à la conception et à la vérification de solutions d’interconnexion et de hiérarchie mémoire destinées à des SoC complexes dans les secteurs du mobile, des télécommunications, de l’automobile et de l’électronique grand public.Dans ce rôle très senior, vous apporterez une expertise approfondie en RTL Design, UVM et vérification système. Vous prendrez en charge des problématiques de vérification complexes et contribuerez à l’évolution des méthodologies, des infrastructures d’automatisation et des pratiques de vérification.Vous travaillerez en étroite collaboration avec les équipes Design, Verification et Engineering afin de garantir des solutions hautement configurables, performantes et de grande qualité.Responsabilités clésConcevoir, développer, maintenir et déboguer des bancs de test basés sur UVM. Définir, documenter, développer et exécuter les stratégies de test et de couverture de vérification RTL au niveau unitaire et système. Analyser les régressions et prendre en charge le débogage de problématiques RTL complexes en Verilog et SystemVerilog. Contribuer activement à la définition et à l’amélioration des processus, méthodologies et métriques de vérification. Développer, maintenir et faire évoluer les outils et infrastructures d’Engineering Design Automation afin d’améliorer les processus frontend de conception et de vérification. Superviser les systèmes automatisés, identifier les problèmes et conduire les analyses et diagnostics nécessaires. Exécuter et optimiser les régressions, configurer les builds Jenkins et assurer le suivi des données associées. Développer et maintenir des dashboards et bases de données de régression permettant d’analyser les tendances, la couverture et l’avancement. Évaluer les infrastructures d’automatisation existantes et définir les axes d’amélioration. Contribuer à l’intégration de VIP pour les environnements de vérification au niveau bloc et système. Produire une documentation technique claire concernant les méthodologies, implémentations, workflows et processus d’automatisation. Collaborer étroitement avec les équipes Design et Verification pour résoudre les problématiques techniques complexes et améliorer la qualité globale des solutions. Partager son expertise technique et contribuer à l’amélioration continue des pratiques de vérification au sein de l’équipe. Profil recherchéQualifications requisesExpérience significative en Design Verification / RTL Verification dans un environnement complexe de développement SoC ou semi-conducteurs. Expertise approfondie en RTL, Verilog et SystemVerilog. Solide expérience dans le développement et le débogage de bancs de test UVM/C. Expérience dans la définition et l’amélioration de méthodologies et stratégies de vérification. Solide expérience dans l’automatisation des flux de vérification à l’aide de Shell, Python et/ou JavaScript. Expérience dans l’intégration de VIP fournis par des éditeurs pour la vérification au niveau bloc et système. Bonne maîtrise des protocoles Arm AMBA, tels que AXI5, ACE et CHI. Solides connaissances en cohérence mémoire hardware et softwareExpérience des environnements de régression et d’intégration continue, notamment Jenkins. Solides capacités d’analyse, de débogage et de résolution de problématiques techniques complexes. Forte autonomie, rigueur et orientation qualité. Capacité à contribuer techniquement au-delà de son propre périmètre et à travailler efficacement avec plusieurs équipes Engineering. Excellentes capacités de communication et de partage des connaissances. Anglais courant, à l’écrit comme à l’oral. Atouts appréciésExpérience sur des conceptions haute performance et basse consommation. Expertise des architectures d’interconnexion et de hiérarchie mémoire SoC. Expérience dans le développement d’infrastructures et d’outils avancés d’automatisation de la vérification. Expérience dans des environnements de conception et de vérification SoC complexes et hautement configurables. Expérience dans la vérification ou le design de systèmes cohérents Expertise en PCIeFormationMaster en génie électrique, électronique, informatique ou domaine connexe privilégié. Bachelor ou diplôme équivalent minimum, ou expérience professionnelle équivalente. Rémunération estimée70 000 à 90 000 brut annuel.La rémunération sera déterminée en fonction de votre expérience, et de l’équité interne pour des postes similaires.À propos d’ArterisArteris est un leader mondial de la propriété intellectuelle (IP) système pour les semi-conducteurs, permettant d’accélérer la conception de puces hautes performances et à faible consommation d’énergie. Les technologies Arteris — notamment les IP d’interconnexion Network-on-Chip (NoC), les logiciels d’automatisation de l’intégration des System-on-Chip (SoC) et les solutions d’assurance de sécurité matérielle — sont utilisées par les plus grandes entreprises mondiales des secteurs des semi-conducteurs et de la technologie afin d’améliorer les performances globales et la productivité des équipes d’ingénierie, de réduire les risques et les coûts, et d’accélérer la mise sur le marché de conceptions complexes. Pour en savoir plus, rendez-vous sur arteris.com. Avec plus de 380 collaborateurs, un siège social situé dans la Silicon Valley et des bureaux dans le monde entier, nous travaillons aussi bien avec des startups qu’avec de grands leaders technologiques internationaux pour développer la prochaine génération de produits électroniques.Nous croyons en l’humain, au sens de notre mission et à l’impact de notre travail. Rejoignez-nous et contribuez à façonner l’avenir.Senior Staff Design Verification EngineerLocation: Sophia Antipolis, FranceArteris connects innovationOur technology helps the world’s most visionary companies—from startups to Fortune 500 leaders—build smarter, faster semiconductors, specifically SoCs and chiplets. From the car you drive to AI in the cloud, Arteris connects the innovative technologies that shape tomorrow.What You’ll Do as a Senior Staff Design Verification Engineer at ArterisDo you want to contribute to the technologies at the heart of some of the world’s most advanced SoCs?As a Senior Staff Design Verification Engineer, you will join an expert engineering team to contribute to the design and verification of interconnect and memory hierarchy solutions for sophisticated mobile, telecom, automotive, and consumer SoC designs.In this highly senior technical role, you will bring deep expertise in RTL Design, UVM, and system-level verification. You will take ownership of complex verification challenges and contribute to the evolution of verification methodologies, automation infrastructure, and engineering practices.You will work closely with Design, Verification, and Engineering teams to deliver highly configurable, high-performance, and high-quality solutions.Key ResponsibilitiesDesign, develop, maintain, and debug UVM-based testbenches. Define, document, develop, and execute unit and system-level RTL verification strategies, tests, and coverage plans. Triage regressions and take ownership of complex RTL debugging in Verilog and SystemVerilog. Actively contribute to defining and improving verification processes, methodologies, and metrics. Develop, maintain, and evolve Engineering Design Automation tools and infrastructure to improve frontend design and verification processes. Monitor automated systems, isolate issues, and perform advanced diagnostics and troubleshooting. Run and optimize regressions, configure Jenkins builds, and collect and analyze regression data. Build and maintain regression dashboards and databases to track trends, coverage, and progress. Evaluate existing automation infrastructure and identify opportunities for improvement. Contribute to the integration of vendor-provided VIPs for block- and system-level verification. Provide clear technical documentation covering methodologies, implementations, workflows, and automation processes. Collaborate closely with Design and Verification teams to resolve complex technical challenges and improve overall solution quality. Share technical expertise and contribute to the continuous improvement of verification practices across the team. What You BringRequired QualificationsSignificant professional experience in Design Verification / RTL Verification within complex semiconductor or SoC development environments. Deep expertise in RTL, Verilog, and SystemVerilog. Strong experience developing and debugging UVM/C testbenches. Experience defining and improving verification methodologies and strategies. Strong experience automating verification flows using Shell, Python, and/or JavaScript. Experience integrating vendor-provided VIPs for block- and system-level verification. Strong knowledge of Arm AMBA protocols such as AXI, ACE and CHI. Strong knowledge of hardware and software memory consistencyExperience with regression and continuous integration environments, including Jenkins. Strong analytical, debugging, and complex problem-solving skills. High degree of autonomy, rigor, and commitment to quality. Ability to contribute technically beyond your immediate scope and collaborate effectively across Engineering teams. Excellent communication and knowledge-sharing skills. Fluent English, written and spoken. Nice to HaveExperience with high-performance, low-power designs. Deep understanding of SoC interconnect and memory hierarchy architectures. Experience developing advanced verification automation tools and infrastructure. Experience working with complex, highly configurable SoC design and verification environments. Experience verifying or designing coherent systems PCIe experience Education RequirementsMaster’s degree in Electrical Engineering, Electronics, Computer Science, or a related field preferred. Bachelor’s degree or equivalent minimum, or equivalent professional experience. Estimated Base Salary70 000 to 90 000 gross annually.Your base salary will be determined based on your experience,and internal pay equity for similar positions.About ArterisArteris is a global leader in system IP used in semiconductors to accelerate the creation of high-performance, power-efficient silicon. Arteris network-on-chip (NoC) interconnect IP system-on-chip (SoC) integration automation software and hardware security assurance technology are used by the world's top semiconductor and technology companies to improve overall performance, engineering productivity, reduce risk, lower costs, and bring complex designs to market faster. Learn more at arteris.com.With over 380 team members headquartered in Silicon Valley and offices around the world, we work with startups and global tech leaders alike to build the next generation of electronic products. We believe in people, purpose and impact. Join us and help shape what comes next.

DescriptionPrincipal Hardware Architect (H/F)Localisation : Sophia Antipolis FranceArteris connecte l’innovationNotre technologie aide les entreprises les plus visionnaires au monde — des startups aux leaders du Fortune 500 à concevoir des semi-conducteurs plus intelligents et plus performants, notamment des SoC et des chiplets.De la voiture que vous conduisez à l’IA dans le cloud, Arteris connecte les technologies innovantes qui façonnent le monde de demain.Votre rôle en tant qu’Architecte Cache Coherency chez ArterisEn tant que Principal Hardware Architect chez Arteris, vous jouerez un rôle clé dans la définition, l’optimisation et l’évolution des solutions de cohérence de cache au sein du portefeuille avancé d’IP d’Arteris.Votre mission principale consistera à concevoir des interconnexions cohérentes de nouvelle génération et à garantir leur intégration fluide avec les autres interconnexions NoC et System IP d’Arteris, afin d’assurer une communication efficace et cohérente entre processeurs, accélérateurs et unités fonctionnelles.Vous travaillerez en étroite collaboration avec les équipes de conception matérielle, de vérification, de développement logiciel ainsi qu’avec les équipes produit et commerciales pour délivrer des solutions NoC haute performance, basse consommation et hautement fiables.Responsabilités clés 1. Architecture de cohérence de cacheApporter votre expertise et évaluer les protocoles de cohérence de cache standards de l’industrie, ainsi que le protocole propriétaire utilisé dans les IP NoC hautement configurables d’ArterisConcevoir des architectures de cohérence de cache complètes, évolutives et robustes, alignées avec les architectures SoC globalesAnalyser les exigences clients pour des systèmes cohérents complexes, y compris le partitionnement en chiplets via des architectures die-to-die et chip-to-chip basées sur des standards tels que CHI C2C, UAlink, UCIe et PCIeDéfinir les objectifs de performance, puissance et surface (PPA) pour les IP configurables2. Intégration NoCCollaborer avec les équipes SoC pour assurer une intégration fluide de la cohérence de cache dans l’architecture globaleOptimiser l’architecture et la micro-architecture de cohérence au sein du NoC afin de réduire la latence et d’augmenter la bande passante3. Performance et optimisation énergétiqueIdentifier les goulots d’étranglement en performance et les problématiques de consommation énergétiqueProposer et mettre en œuvre des solutions innovantes pour améliorer l’efficacité globaleCollaborer avec les équipes matérielles et logicielles pour vérifier et optimiser les mécanismes de cohérence4. Vérification des protocolesAccompagner les équipes de vérification dans la définition de stratégies de vérification garantissant la robustesse et la conformité des protocoles de cohérenceSoutenir les équipes d’émulation lors des phases de test et de debug afin de valider les comportements de cohérence en conditions fonctionnelles et de performance variées5. Collaboration transverseInteragir avec les équipes marketing et commerciales afin de recueillir les besoins clients et les exigences marchéCollaborer étroitement avec les équipes de conception matérielle, logicielle et d’architecture systèmeFournir une expertise technique aux équipes Application Engineering pour faciliter l’intégration des produits chez les clients6. Veille technologique et innovationAssurer une veille active sur les avancées en cohérence de cache, technologies NoC et interfaces die-to-dieÉvaluer les nouveaux standards, méthodologies et tendances industrielles et proposer leur intégration dans les IP Arteris7. Documentation et communicationRédiger une documentation technique détaillée : spécifications d’architecture, guides de conception, white papersCommuniquer efficacement des concepts techniques complexes à des interlocuteurs techniques et non techniquesProfil recherchéQualifications requisesDiplôme d’ingénieur, Master ou équivalent en électronique, informatique ou domaine connexeExpérience confirmée en tant qu’Architecte Cache Coherency, architecte SoC/NoC ou ingénieur conception avancéeExcellente maîtrise des architectures SoC et NoC, des protocoles de cohérence de cache et des hiérarchies mémoireSolide compréhension de l’interaction entre caches et interconnexions NoCConnaissance des langages de description matérielle (HDL) et des outils de conception SoCExcellentes capacités d’analyse, de résolution de problèmes et vision architecturaleTrès bonnes compétences en communication et collaboration transverseAtouts appréciésExpérience dans la conception de systèmes cohérents complexesConnaissance approfondie des standards CHI, UCIe, PCIe, UAlinkContribution à des projets IP NoC ou SoC à forte visibilité industrielleFormationDiplôme d’ingénieur, Master ou Doctorat en électronique, informatique ou domaine connexe, ou expérience professionnelle équivalenteRémunérationSalaire de base estimé : 65 000 à 100 000 brut annuel.La rémunération finale sera déterminée en fonction du lieu, de l’expérience et de l’équité interne pour des postes similaires.À propos d’Arteris Arteris est un leader mondial des System IP pour semi-conducteurs, permettant d’accélérer la conception de silicium haute performance et basse consommation. Les solutions Network-on-Chip (NoC) d’Arteris et ses logiciels d’automatisation de l’intégration SoC sont utilisés par les plus grandes entreprises technologiques afin d’améliorer les performances, la productivité des équipes d’ingénierie, de réduire les risques et les coûts, et d’accélérer la mise sur le marché de conceptions complexes.Principal Hardware Architect (H/F)Location: Sophia Antipolis FranceArteris connects innovationOur technology helps the world’s most visionary companies—from startups to Fortune 500 leaders—build smarter, faster semiconductors, specifically SoCs and chiplets. From the car you drive to the AI in the cloud, Arteris connects the innovative technology that shapes tomorrow.What You’ll Do as a Cache Coherency Architect at ArterisAs a Principal Hardware Architectat Arteris, you will be a key contributor in defining, optimizing, and evolving cache coherency solutions within Arteris’ advanced IP portfolio.Your primary focus will be on developing cutting-edge cache-coherent interconnect IP and ensuring seamless integration with other NoC interconnects and system IP, enabling efficient and coherent communication between multiple processor cores, accelerator cores, and functional units.You will collaborate closely with hardware designers, verification engineers, software developers, product teams, and customer-facing teams to deliver high-performance, power-efficient, and reliable NoC IP solutions.Key Responsibilities1. Cache Coherency ArchitectureProvide expertise and evaluate industry-standard cache coherency protocols, as well as Arteris’ proprietary coherency protocol used within our highly configurable NoC IPDevelop scalable and robust cache coherency architectures aligned with overall System-on-Chip (SoC) designsAnalyze customer requirements for cache-coherent system architectures, including partitioning large designs into chiplets using die-to-die and chip-to-chip standards such as CHI C2C, UAlink, UCIe, and PCIeDefine performance, power, and area (PPA) targets for configurable IP2. NoC IntegrationCollaborate with SoC design teams to ensure seamless integration of cache coherency into system architecturesOptimize cache coherency architecture and microarchitecture within the NoC to reduce latency and increase bandwidth3. Performance and Power OptimizationAnalyze performance bottlenecks and power consumption challengesPropose and implement innovative solutions to improve overall efficiencyWork closely with hardware and software teams to verify and optimize cache coherency mechanisms4. Protocol VerificationSupport verification teams in defining verification strategies to ensure correctness and robustness of cache coherency protocols and their implementation within the NoC IPSupport emulation teams in testing and debugging to validate cache coherency behavior across functional and performance scenarios5. Cross-Functional CollaborationInteract with marketing and sales teams to capture customer input and understand market and product requirementsCollaborate with hardware design, software development, and system architecture teams to address technical needs and challengesProvide technical expertise and support to Application Engineering teams to assist with customer integration of Arteris products6. Industry Research and InnovationStay up to date with the latest advancements in cache coherency, NoC technologies, and die-to-die interfacesEvaluate emerging standards, methodologies, and industry trends, and propose their adoption to enhance Arteris’ NoC IP offerings7. Documentation and CommunicationProduce detailed technical documentation, including architecture specifications, design guidelines, and white papersCommunicate complex technical concepts clearly to both technical and non-technical stakeholdersWhat You BringRequired QualificationsBachelor’s or Master’s degree in Electrical Engineering, Computer Engineering, or a related fieldProven experience as a Cache Coherency Architect, SoC/NoC Architect, or senior design engineerIn-depth knowledge of SoC and NoC architectures, cache coherency protocols, and memory hierarchiesStrong understanding of cache hierarchies and their interaction with NoC interconnectsFamiliarity with hardware description languages (HDLs) and SoC design toolsStrong analytical, problem-solving, and system-level thinking skillsExcellent communication and collaboration abilitiesPreferred QualificationsExperience designing complex coherent systemsStrong knowledge of CHI, UCIe, PCIe, UAlink, and related standardsPrior experience contributing to NoC IP or large-scale SoC projectsEducation RequirementsBachelor’s, Master’s, or PhD degree in a relevant engineering field, or equivalent professional experienceCompensationEstimated Base Salary: 65,000 to 100,000 annually.Final compensation will be determined based on location, experience, and internal equity for similar roles.About ArterisArteris is a global leader in system IP used in semiconductors to accelerate the creation of high-performance, power-efficient silicon. Arteris’ Network-on-Chip (NoC) interconnect IP and system-on-chip (SoC) integration automation software are used by the world’s top semiconductor and technology companies to improve performance, engineering productivity, reduce risk, lower costs, and bring complex designs to market faster.

DescriptionIngénieur Sécurité Fonctionnelle (H/F)Localisation : Sophia Antipolis , FranceArteris connecte l’innovationNotre technologie aide les entreprises les plus visionnaires au monde — des startups aux leaders du Fortune 500 à concevoir des semi-conducteurs plus intelligents et plus performants, notamment des SoC et des chiplets.De la voiture que vous conduisez à l’IA dans le cloud, Arteris connecte les technologies innovantes qui façonnent le monde de demain.Votre rôle en tant qu’Ingénieur Sécurité Fonctionnelle chez ArterisSouhaitez-vous contribuer à l’ossature de certains des SoC les plus utilisés au monde ?En tant qu’Ingénieur Sécurité Fonctionnelle chez Arteris, vous jouerez un rôle clé dans le développement et la compilation des livrables de sécurité fonctionnelle conformes à la norme ISO 26262 pour nos IP semi-conducteurs. Votre mission portera principalement sur les exigences de sécurité fonctionnelle matérielle ainsi que sur les analyses de sécurité (FMEA, FMEDA, DFA).Vous travaillerez en étroite collaboration avec les équipes d’architecture, de conception et de vérification afin de définir et mettre en œuvre des mécanismes de sécurité matériels adaptés, aux niveaux architecture et micro-architecture, pour garantir la conformité aux exigences de sécurité technique.Vous contribuerez également aux activités d’injection de fautes, à leur planification ainsi qu’à l’analyse des résultats.Responsabilités clésÊtre le/la référent(e) Sécurité Fonctionnelle au sein des équipes IP pour l’ensemble des produits IP matériels liés à la sécuritéDéfinir et contribuer aux exigences de sécurité fonctionnelle matérielle et aux exigences de sécurité techniqueCollaborer avec les architectes, concepteurs et responsables de la vérification afin d’intégrer les exigences de sécurité dans les conceptionsAssurer la traçabilité des exigences à l’aide d’outils tels que Jama Software, Atlassian Jira et de documents structurés (ex. Adobe Structured FrameMaker)Réaliser les analyses de sécurité (FMEA, FMEDA, DFA) et rédiger les rapports associésAccompagner les équipes IP dans le choix des mécanismes de sécurité matériels appropriés aux niveaux architecture et micro-architectureCompiler et maintenir le Safety Case IP ainsi que le Safety ManualRéaliser des analyses d’impact sécurité fonctionnelle suite aux demandes de modification de conceptionPiloter les révisions du Safety Plan, du Technical Safety Concept et des hypothèses SEooCProfil recherchéQualifications requisesSolides compétences en conception et architecture numérique, avec une approche structurée et orientée processusMinimum 5 ans d’expérience (ou équivalent) en architecture, conception et vérification/validation de SoC et systèmesBonne compréhension des micro-architecturesMinimum 3 ans d’expérience en sécurité fonctionnelle dans le domaine des semi-conducteursExcellente maîtrise de la norme ISO 26262Connaissances de base des architectures ARM et des protocoles AMBA (APB, AXI, ACE, CHI)Expérience avec les outils EDA standards de l’industrie (synthèse logique, simulation pilotée par la couverture)Atouts appréciésExpérience pratique avec des outils d’injection de fautesParticipation à des projets SoC ou IP certifiés sécuritéFormationDiplôme d’ingénieur, Master ou Doctorat en électronique, informatique, microélectronique ou domaine connexe, ou expérience professionnelle équivalenteRémunérationSalaire de base estimé : 55 000 à 70 000 brut annuel.La rémunération finale sera déterminée en fonction du lieu, de l’expérience et de l’équité interne pour des postes similaires.À propos d’ArterisArteris est un leader mondial des System IP pour semi-conducteurs, permettant d’accélérer la conception de silicium haute performance et basse consommation. Les solutions Network-on-Chip (NoC) d’Arteris et ses logiciels d’automatisation de l’intégration SoC sont utilisés par les plus grandes entreprises technologiques afin d’améliorer les performances, la productivité des équipes d’ingénierie, de réduire les risques et les coûts, et d’accélérer la mise sur le marché de conceptions complexes.Functional Safety Engineer (H/F)Localisation : Sophia Antipolis , FranceArteris connects innovationOur technology helps the world’s most visionary companies—from startups to Fortune 500 leaders—build smarter, faster semiconductors, specifically SoCs and chiplets. From the car you drive to the AI in the cloud, Arteris connects the innovative technology that shapes tomorrow.What You’ll Do as a Functional Safety Engineer at ArterisDo you want to contribute to the backbone of some of the world’s most popular SoCs?As a Functional Safety Engineer at Arteris, you will play a key role in the development and compilation of ISO 26262 functional safety work products for our semiconductor IP. Your focus will be on hardware functional safety requirements and safety analyses (FMEA, FMEDA, DFA).You will work closely with architecture, design, and verification teams to define and implement appropriate hardware safety mechanisms at both architecture and microarchitecture levels, ensuring compliance with Technical Safety Requirements. You will also support fault injection activities, contributing to planning, execution, and results reviews.Key ResponsibilitiesAct as the lead Functional Safety Engineer within the IP team for all safety-related semiconductor design IP productsDefine and contribute to Hardware Functional Safety Requirements and Technical Safety RequirementsCollaborate with architects, designers, and design verification leaders to define and implement functional safety requirements in the designEnsure requirements traceability using tools such as Jama Software, Atlassian Jira, and structured documentation (e.g. Adobe Structured FrameMaker)Create and maintain Safety Analyses including FMEA, FMEDA, and DFA, and prepare associated safety reportsSupport IP teams in selecting appropriate hardware safety mechanisms at architecture and microarchitecture levelsCompile and maintain the IP Safety Case and Safety ManualPerform functional safety impact analyses in response to design change requestsLead revisions of the Design Safety Plan, Technical Safety Concept, and SEooC AssumptionsWhat You BringRequired QualificationsStrong digital design and architecture skills, with a structured and process-oriented mindset5+ years of experience (or equivalent) in SoC and system architecture, design, and verification/validationSolid understanding of micro-architectures3+ years of experience in Functional Safety for semiconductor applicationsDeep knowledge of ISO 26262 functional safety standardsBasic understanding of ARM architectures and AMBA protocols (APB, AXI, ACE, CHI)Experience with industry-standard EDA tools (logic synthesis, coverage-driven simulation)Preferred QualificationsHands-on experience with fault injection toolsPrior exposure to safety-certified IP or SoC development projectsEducation RequirementsMaster’s degree or PhD in Electrical Engineering, Computer Engineering, or a related field, or equivalent professional experienceCompensationEstimated Base Salary: 55,000 to 70,000 annually.Final compensation will be determined based on location, experience, and internal pay equity for similar roles.About ArterisArteris is a global leader in system IP used in semiconductors to accelerate the creation of high-performance, power-efficient silicon. Arteris’ Network-on-Chip (NoC) interconnect IP and system-on-chip (SoC) integration automation software are used by the world’s top semiconductor and technology companies to improve performance, engineering productivity, reduce risk, lower costs, and bring complex designs to market faster.With over 280 team members headquartered in Silicon Valley and offices around the world, we work with startups and global technology leaders alike to build the next generation of electronic products. We believe in people, purpose, and impact. Join us and help shape what comes next.

DescriptionStaff Performance Modeling Engineer H/FLocation: Sophia-Antiopolis, FranceArteris connecte l’innovationNotre technologie aide les entreprises les plus visionnaires du monde — des startups aux leaders du Fortune 500 — à concevoir des semi-conducteurs plus intelligents et plus performants, notamment des SoC et des chiplets. De la voiture que vous conduisez à l’IA dans le cloud, Arteris connecte les technologies innovantes qui façonnent le monde de demain.Votre rôle en tant qu’Ingénieur en Modélisation de Performance chez ArterisEn tant qu’Ingénieur en modélisation de performance chez Arteris, vous rejoindrez une équipe d’experts dédiée à la conception et à la livraison de solutions d’interconnexion et de hiérarchie mémoire pour certains des SoC les plus avancés dans les domaines du mobile, des télécommunications, de l’automobile et de l’électronique grand public.Dans ce rôle, vous modéliserez des architectures complexes et hautement configurables et produirez des analyses de performance qui orienteront directement les décisions d’architecture. Vous travaillerez en étroite collaboration avec les équipes internes et les clients afin de fournir des solutions d’analyse et d’estimation de performance. Ce poste offre une exposition transverse sur l’architecture, le développement et la vérification, vous permettant d’avoir un impact réel au-delà d’un périmètre cloisonné.Responsabilités principales· Développer et maintenir des modèles logiciels de performance pour des architectures SoC complexes, incluant les interconnexions et les hiérarchies mémoire· Analyser les performances systèmes et produire des rapports détaillés afin de guider les décisions d’architecture et de micro-architecture· Piloter les améliorations d’architecture grâce à des analyses de performance basées sur la modélisation· Modéliser des conceptions hautement configurables à l’aide de SystemC, C++ et TLM 2.0· Collaborer étroitement avec les équipes internes (architecture, développement, vérification· Accompagner les clients en leur fournissant des solutions d’analyse et d’estimation de performance· Contribuer à l’amélioration continue des méthodologies, outils et flux de modélisationVotre profilQualifications requises· Minimum 5 ans d’expérience dans le développement de modèles logiciels de performance pour des systèmes tels que CPU, GPU, accélérateurs IA, Network-on-Chip (NoC) ou équivalent· Minimum 5 ans d’expérience dans l’amélioration de l’architecture et de la micro-architecture via l’analyse de modèles de performance· Solide expérience en SystemC, C++ et/ou TLM 2· Excellentes capacités d’analyse, de résolution de problèmes et de débogage· Capacité à proposer des idées, analyser des compromis techniques et communiquer clairement les résultats· Aptitude avérée à travailler efficacement au sein d’équipes techniques expérimentéeQualifications souhaitées· Connaissance des processeurs ARM et des interfaces on-chip telles que AXI, AHB, ainsi que des interfaces chip-to-chip (UCIe, PCIe)· Bonne maîtrise des protocoles de cohérence de cache, notamment CHI· Expérience avec des générateurs de code pour la création de descriptions matérielles configurables· Expérience avec des langages de script tels que Python, TCL ou Perl· Expérience avec l’outil Platform ArchitectFormation· Diplôme de Licence ou Master en Génie électrique, Génie informatique ou domaine connexe, ou expérience professionnelle équivalente· Maîtrise de l’anglais et du françaisRémunération Salaire de base estimé : 55 000 à 70 000 brut annuel.La rémunération sera déterminée en fonction du lieu, de l’expérience et de l’équité interne pour des postes similaires.À propos d’ArterisArteris est un leader mondial de la propriété intellectuelle (IP) système pour les semi-conducteurs, permettant d’accélérer la conception de puces hautes performances et à faible consommation d’énergie. Les technologies Arteris — notamment les IP d’interconnexion Network-on-Chip (NoC), les logiciels d’automatisation de l’intégration des System-on-Chip (SoC) et les solutions d’assurance de sécurité matérielle — sont utilisées par les plus grandes entreprises mondiales des secteurs des semi-conducteurs et de la technologie afin d’améliorer les performances globales et la productivité des équipes d’ingénierie, de réduire les risques et les coûts, et d’accélérer la mise sur le marché de conceptions complexes. Pour en savoir plus, rendez-vous sur arteris.com. Avec plus de 380 collaborateurs, un siège social situé dans la Silicon Valley et des bureaux dans le monde entier, nous travaillons aussi bien avec des startups qu’avec de grands leaders technologiques internationaux pour développer la prochaine génération de produits électroniques.Nous croyons en l’humain, au sens de notre mission et à l’impact de notre travail. Rejoignez-nous et contribuez à façonner l’avenir.Staff Performance Modeling Engineer H/FLocation: Montigny le Bretonneux, FranceArteris Connects InnovationOur technology helps the world’s most visionary companies—from startups to Fortune 500 leaders—build smarter, faster semiconductors, specifically SoCs and chiplets. From the car you drive to the AI in the cloud, Arteris connects the innovative technology that shapes tomorrow.Your Role as a Performance Modeling Engineer at ArterisAs a Performance Modeling Engineer at Arteris, you will join an expert team designing and delivering interconnect and memory hierarchy solutions for some of the world’s most advanced mobile, telecom, automotive, and consumer SoC products.In this role, you will model complex, highly configurable designs and deliver performance analyses that directly influence architectural decisions. You will work closely with internal teams and customers to provide performance estimation and analysis solutions. This position offers broad exposure across architecture, development, and verification, allowing you to have a real impact beyond a single silo. Key ResponsibilitiesDevelop and maintain software-based performance models for complex SoC architectures, including interconnects and memory hierarchiesAnalyze system performance and produce detailed reports to guide architecture and microarchitecture decisionsDrive architectural improvements through data-driven performance modeling and analysisModel highly configurable designs using SystemC, C++, and TLM 2.0Collaborate with internal engineering teams across architecture, development, and verificationSupport customers by providing performance analysis, estimation solutions, and technical expertiseContribute to improving modeling methodologies, tools, and workflowsWhat You BringRequired Qualifications5+ years of experience developing software performance models for one or more of the following: CPUs, GPUs, AI accelerators, Network-on-Chip (NoC), or equivalent systems5+ years of experience driving architecture and microarchitecture improvements through performance model analysisStrong experience with SystemC, C++, and/or TLM 2.0Strong problem-solving, debugging, and analytical skillsAbility to brainstorm, explore trade-offs, and communicate technical insights clearlyProven ability to work effectively within experienced, cross-functional engineering teamsPreferred QualificationsFamiliarity with ARM processors and on-chip interfaces such as AXI, AHB, and chip-to-chip interfaces like UCIe and PCIeStrong knowledge of cache coherency protocols such as CHIExperience with code generators for configurable hardware descriptionsExperience with scripting languages such as Python, TCL, or PerlExperience with Platform Architect toolsEducation RequirementsBachelor’s or master’s degree in electrical engineering, Computer Engineering, or a related field, or equivalent professional experienceFluent in English and FrenchCompensation EstimatedBase Salary: 55,000 to 70,000 annually.Your base salary will be determined based on your location, experience, and internal pay equity for similar roles.About ArterisArteris is a global leader in system IP used in semiconductors to accelerate the creation of high-performance, power-efficient silicon. Arteris network-on-chip (NoC) interconnect IP system-on-chip (SoC) integration automation software and hardware security assurance technology are used by the world's top semiconductor and technology companies to improve overall performance, engineering productivity, reduce risk, lower costs, and bring complex designs to market faster. Learn more at arteris.com.With over 380 team members headquartered in Silicon Valley and offices around the world, we work with startups and global tech leaders alike to build the next generation of electronic products. We believe in people, purpose and impact. Join us and help shape what comes next.

DescriptionStaff Software Development Engineer H/FLocalisation : Sophia Antipolis, FranceArteris connecte l’innovationNotre technologie aide les entreprises les plus visionnaires du monde — des startups aux leaders du Fortune 500 — à concevoir des semi-conducteurs plus intelligents et plus performants, notamment des SoC et des chiplets. De la voiture que vous conduisez à l’IA dans le cloud, Arteris connecte les technologies innovantes qui façonnent le monde de demain.Votre rôle en tant que Staff Software Development Engineer chez ArterisRejoignez notre équipe innovante et contribuez à façonner l’avenir des technologies des semi-conducteurs, en particulier les systèmes sur puce (SoC) et les chiplets.Dans ce rôle, vous serez en charge de piloter et de contribuer au développement d’une pile logicielle avancée dédiée à la configuration et à l’évaluation de la nouvelle génération de solutions Network-on-Chip (NoC) économiques d’Arteris. Vous travaillerez en étroite collaboration avec des équipes pluridisciplinaires afin de livrer des solutions à fort impact et de haute qualité.Responsabilités clésPiloter et contribuer au développement d’une pile logicielle avancée dédiée à la configuration et à l’évaluation d’une nouvelle génération de NoC Arteris à coût optimiséDéfinir les workflows utilisateurs en étroite collaboration avec les équipes Marketing et Field Application Engineering (FAE)Spécifier les couches d’interopérabilité entre ce logiciel et les autres applications Arteris, en particulier les modèles SystemC des IP NoCSpécifier, concevoir et diriger le développement des composants backend et frontend de l’applicationCommuniquer efficacement avec les autres équipes afin d’assurer la cohérence globale des produitsProfil recherchéQualifications requisesMinimum 6 ans d’expérience en développement logicielSolide expertise dans l’architecture et le développement de framework (maintient d'APIs, support utilisateurs avancés, versionnement)Excellente maîtrise de la programmation orientée objet (Java, C++, Python ou équivalent)Excellente maîtrise de la programmation fonctionnelle (Haskell, Scala, OCaml ou équivalent)Excellentes capacités d’analyse et de résolution de problèmesTrès bonnes compétences en communication et en travail d’équipeAutonomie, capacité à travailler avec un minimum de supervisionAnglais courant (oral et écrit)Atouts appréciésExpérience avec d’autres langages de programmation (Scala, Rust, Kotlin, etc.)Expérience en modélisation de systèmes numériques (SystemC, TLM)Connaissances en EDA et compréhension des principaux paradigmes de conception SoCExpérience avec les générateurs de matériel numérique, les méthodologies et concepts associésFormationDoctorat ou Master en informatique ou dans un domaine connexe, ou expérience professionnelle équivalenteRémunérationSalaire de base estimé : 55,000 à 70,000 par an.La rémunération sera déterminée en fonction du lieu, de l’expérience et de l’équité interne pour des postes similaires.À propos d’ArterisArteris est un leader mondial des System IP pour semi-conducteurs, permettant d’accélérer la conception de silicium haute performance et basse consommation. Les solutions Network-on-Chip (NoC) d’Arteris et ses logiciels d’automatisation de l’intégration SoC sont utilisés par les plus grandes entreprises du secteur afin d’améliorer les performances globales, la productivité des équipes d’ingénierie, de réduire les risques et les coûts, et d’accélérer la mise sur le marché de conceptions complexes.Avec plus de 300 collaborateurs, un siège social en Silicon Valley et des bureaux dans le monde entier, Arteris collabore aussi bien avec des startups qu’avec des leaders technologiques mondiaux pour construire la prochaine génération de produits électroniques. Nous croyons aux personnes, au sens et à l’impact. Rejoignez-nous et participez à ce qui vient ensuite.-------------------------------------------------------------------------------------------------------------------------------------Staff Software Development Engineer H/FLocation: Sophia Antipolis, FranceArteris connects innovationOur technology helps the world’s most visionary companies—from startups to Fortune 500 leaders—build smarter, faster semiconductors, specifically SoCs and chiplets. From the car you drive to the AI in the cloud, Arteris connects the innovative technology that shapes tomorrow.What You’ll Do as a Staff Software Development Engineer at ArterisJoin our innovative team and help shape the future of semiconductor technology, specifically system-on-chip (SoC) and chiplets. In this role, you will lead and contribute to the development of an advanced software stack dedicated to the configuration and evaluation of Arteris’ next-generation cost-effective Network-on-Chip (NoC) solutions. You will collaborate closely with cross-functional teams to deliver impactful, high-quality products.Key ResponsibilitiesLead and contribute to the development of an advanced software stack for the configuration and evaluation of a new generation of Arteris cost-effective NoCDefine user workflows in close cooperation with Marketing and Field Application Engineering (FAE) teamsSpecify interoperability layers between this software and other Arteris applications, particularly SystemC models of the NoC IPSpecify, design, and lead the development of backend and frontend components of the applicationCommunicate effectively with other teams to ensure product cohesion and alignmentWhat You BringRequired Qualifications6+ years of experience in software developmentStrong proficiency in architecture and development of frameworks (maintaining APIs, advanced user support, release flows)Expert knowledge of object-oriented programming (Java, C++, Python, or equivalent)Expert knowledge of functionnal programming (Haskell, Scala, OCaml or equivalent)Excellent problem-solving skills with strong communication and teamwork abilitiesSelf-driven, able to work with minimal supervisionFluent in EnglishPreferred QualificationsExperience with additional programming languages such as Scala, Rust, or KotlinExperience in digital system modeling (SystemC, TLM)EDA background with the ability to understand the fundamental paradigms of the SoC design processExperience with digital hardware generators, methodologies, and conceptsEducation RequirementsPhD or Master’s degree in Computer Science or a related field, or equivalent professional experienceCompensationEstimated Base Salary: 55,000 à 70,000 annually.Your base salary will be determined based on your location, experience, and the pay of employees in similar positions. About ArterisArteris is a global leader in system IP used in semiconductors to accelerate the creation of high-performance, power-efficient silicon. Arteris’ network-on-chip (NoC) interconnect IP and system-on-chip (SoC) integration automation software are used by the world’s top semiconductor and technology companies to improve performance, engineering productivity, reduce risk, lower costs, and bring complex designs to market faster.With over 300 team members headquartered in Silicon Valley and offices around the world, we work with startups and global technology leaders alike to build the next generation of electronic products. We believe in people, purpose, and impact. Join us and help shape what comes next.

Pour une de nos familles, nous sommes à la recherche d'un(e) baby-sitter à domicile à PEGOMAS pour 5 heures de travail par semaine pour baby-sitter 1 enfant, 4 ans.Tâches confiées : garde d'enfants/baby-sitting, préparation des repas, aide à la toilette, sortie d'école, activités petite enf

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L'aide-soignant(e) assiste les patients dans les soins d'hygiène et les activités quotidiennes, tout en collaborant avec une équipe pluridisciplinaire.

Assurer les soins quotidiens, incluant l'hygiène corporelle et le confort des résidents- Participer activement à l'organisation et à l'animation des activités stimulantes pour les résidents- Collaborer avec l'équipe médicale pour surveiller l'état de santé des résidents et signaler tout c

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L'Aide-Soignant(e) assure l'hygiène et le confort des patients à domicile, collabore avec l'équipe médicale et participe à l'organisation des soins.

Spécialiste du recrutement dans la santé depuis plus de 50 ans, la force d'Appel Médical réside dans ses équipes d'experts, passionnés par le secteur de la santé et engagés quotidiennement auprès du personnel soignant.Pour un poste dans le secteur médical, nous mettons notre expertise en s

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L'aide-soignant fournit un soutien quotidien aux patients à domicile, effectuant des soins d'hygiène et surveillant leur état de santé.

Parce que la santé est un enjeu essentiel, dont l'humain est la pierre angulaire, les femmes et les hommes d'Appel Médical sont engagés depuis plus de 50 ans aux côtés des soignants. Comment envisagez-vous d'améliorer le bien-être des résidents en tant qu'Aide soignant(e) ?Vo

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Comment souhaitez-vous contribuer au bien-être des résidents en tant qu'Aide soignant(e) dans un Établissement pour Personnes Âgées ?Dans un établissement pour personnes âgées, vous serez responsable de l'accompagnement des résidents dans leurs besoins quotidiens- Assister les rési

Comment souhaiteriez-vous contribuer au bien-être des patients dans un établissement de Soins de Suite et Réadaptation en tant qu'Aide-soignant(e) (F/H) ?Au sein d'un établissement de soins de suite et réadaptation, vous serez intégré(e) à une équipe soignante pour contribuer au bie

Pour une de nos familles, nous sommes à la recherche d'un(e) baby-sitter à domicile à BIOT pour 6 heures de travail par semaine pour baby-sitter 1 enfant, 8 ans.Tâches confiées : garde d'enfants/baby-sitting, préparation des repas, aide à la toilette, sortie d'école, activités petite enfanc

Pour l'un de nos clients intervenant sur différents chantiers d'aménagement et de menuiserie dans les Alpes-Maritimes, nous recherchons un Aide Menuisier H/F. Vos missions :Sous la responsabilité d'un menuisier expérimenté, vous participerez notamment à :Aider à la pose d'él�

Aide à la décision : Systèmes décisionnels, optimisation, analyse multicritère. Vous développez une activité scientifique reconnue ou à fort potentiel dans les domaines de l'intelligence artificielle, de la science des données ou de l'aide à la décision.

Dans le cadre d'un remplacement, nous recherchons un(e) Responsable d'Agence en CDI basé à Saint Germain en Laye.Après une période d'intégration, votre objectif principal sera de développer votre agence dans un environnement concurrentiel en forte croissance.Dans ce cadre, vos miss